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饶先宏 / hdl4se

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“f6dd39a9bd052a700c6a88e24a1c81b0d741fad7”上不存在“examples/hdl4se_riscv/verilog/riscv_axi/riscv_core_v5.v”
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云IDE
克隆

项目简介

verilog compile and simulate

发行版本 10

hdl4se-0.4.0-20210903.1639

全部发行版

贡献者 1

饶先宏 @m0_56903617

开发语言

  • Charity 92.3 %
  • C 5.4 %
  • Makefile 1.3 %
  • Yacc 0.5 %
  • CMake 0.3 %